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楼主: 不拘一格

FC 声音正常图象出现杂色方块的不兼容现象

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发表于 2016-6-8 16:44:45 | 显示全部楼层
不拘一格 发表于 2016-3-21 17:14
1 k% b+ q4 B+ F/ r+ T4 Z上面我做成本最低的二极管搭电路,需要选合适的高速开关二极管,同时上下拉电阻阻值在不同的机器中也要调整 ...
8 D' D4 ]( K9 S0 x
请问楼主74HC32N_6V与74HC08N_6V是同一个芯片还是连个芯片
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发表于 2016-6-8 19:02:22 | 显示全部楼层
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被接地,才会冲突,设计上无任何问题!fc每一个零件,每一个环节我都仔细研究了- u6 o7 `0 r% m
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 楼主| 发表于 2016-7-1 01:59:52 | 显示全部楼层
本帖最后由 不拘一格 于 2016-7-1 02:01 编辑
' _) B: C" F' \; x# l7 {
孙大师 发表于 2016-6-8 19:02
# q0 i5 q5 ^0 e& Y3 F/ @& T吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被 ...
5 c+ Q: a0 |4 e7 Y/ p, I- h# q

* R6 P. _% Q% _( I/ e/OE永远接地这种做法是不推荐的。+ S2 `, C6 t) ^8 s* Q  y
! c& h! ~. p" s8 [
FC的设计是“技巧精妙”与“离经判道的”。之所以这样是为了压低硬件设计成本。) R% l3 m1 @1 q9 F0 X" q4 _; q

3 \; w) A1 }) Y可能FC本身没有一个完善的/OE逻辑产生电路,如果要做这样的电路,需要消耗74门,或者用cpld写一个类似总线仲裁的桥接逻辑;
8 n8 o' r3 k: |2 Y1 ^9 v. ~, A! I/ T, d! X  H# q2 i
以上修改其实也是用最低成本实现避免时序的交错。  C6 G" B- O' d+ [8 F
$ Y9 z5 a% D2 _# Z' g4 X& S
理论的/OE时序信号,可以参考MD,以下是MD的信号在逻辑分析仪上测量抓取的图片(图片借用他人)) `4 L5 g! F. `+ m

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