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楼主: 不拘一格

FC 声音正常图象出现杂色方块的不兼容现象

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发表于 2016-6-8 16:44:45 | 显示全部楼层
不拘一格 发表于 2016-3-21 17:14% U, H! ]6 k# a) q9 u9 ^+ x
上面我做成本最低的二极管搭电路,需要选合适的高速开关二极管,同时上下拉电阻阻值在不同的机器中也要调整 ...

9 {+ T8 l$ ~! l5 W6 S请问楼主74HC32N_6V与74HC08N_6V是同一个芯片还是连个芯片
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发表于 2016-6-8 19:02:22 | 显示全部楼层
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被接地,才会冲突,设计上无任何问题!fc每一个零件,每一个环节我都仔细研究了
6 ^3 Q/ H5 j- o: n  a
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 楼主| 发表于 2016-7-1 01:59:52 | 显示全部楼层
本帖最后由 不拘一格 于 2016-7-1 02:01 编辑 & b) I% d# P! l: m
孙大师 发表于 2016-6-8 19:02& G' a( j* k+ y3 u9 p
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被 ...
( `, q* n( I( S0 o

2 u7 ~4 l9 q; J1 l/OE永远接地这种做法是不推荐的。8 c( z9 T/ V3 u/ l" P3 B
0 R4 r$ S# t# }$ U8 g5 V
FC的设计是“技巧精妙”与“离经判道的”。之所以这样是为了压低硬件设计成本。
  b8 b- C! H* L$ y' y8 s/ F5 N9 Y. F% V3 [5 K* F7 L  ]
可能FC本身没有一个完善的/OE逻辑产生电路,如果要做这样的电路,需要消耗74门,或者用cpld写一个类似总线仲裁的桥接逻辑;
0 D7 q# C6 h" J4 M" x- ]; y$ n6 W/ y8 N, j# r$ K% b
以上修改其实也是用最低成本实现避免时序的交错。+ k5 V6 w6 k) o! Q( P( ^

& p9 n. O( X! d8 U% b$ b7 ]3 m  N) Q理论的/OE时序信号,可以参考MD,以下是MD的信号在逻辑分析仪上测量抓取的图片(图片借用他人)
4 U- Z8 _7 j/ O6 t4 V

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