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楼主: 不拘一格

FC 声音正常图象出现杂色方块的不兼容现象

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发表于 2016-6-8 16:44:45 | 显示全部楼层
不拘一格 发表于 2016-3-21 17:14" d' [; R1 m$ U* ?
上面我做成本最低的二极管搭电路,需要选合适的高速开关二极管,同时上下拉电阻阻值在不同的机器中也要调整 ...

& M1 q3 a( a! H! J+ R; [请问楼主74HC32N_6V与74HC08N_6V是同一个芯片还是连个芯片
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发表于 2016-6-8 19:02:22 | 显示全部楼层
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被接地,才会冲突,设计上无任何问题!fc每一个零件,每一个环节我都仔细研究了  Q# i' ~/ T5 l3 C/ b0 N
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 楼主| 发表于 2016-7-1 01:59:52 | 显示全部楼层
本帖最后由 不拘一格 于 2016-7-1 02:01 编辑 2 g% W1 Z2 j2 p- a3 E+ |
孙大师 发表于 2016-6-8 19:02
  s2 x2 b2 n8 {' h吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被 ...

) k- ?+ U2 x+ K2 X* a! n7 H2 D% u* Z& u; M" _/ b
/OE永远接地这种做法是不推荐的。& U2 H0 U% X8 h! Y/ I

% R. X0 B. c6 v% I9 M9 F3 q. zFC的设计是“技巧精妙”与“离经判道的”。之所以这样是为了压低硬件设计成本。
7 j4 f% P9 r+ @/ W, ~
- _/ r- d+ B/ I- ]可能FC本身没有一个完善的/OE逻辑产生电路,如果要做这样的电路,需要消耗74门,或者用cpld写一个类似总线仲裁的桥接逻辑;( Y* p& m8 \( j4 x- d/ M% A

4 I1 a5 T- V$ n9 E以上修改其实也是用最低成本实现避免时序的交错。. J. h- A$ M0 ~) c
  E+ v1 s- E. C
理论的/OE时序信号,可以参考MD,以下是MD的信号在逻辑分析仪上测量抓取的图片(图片借用他人)* K! A" h8 M! V4 K

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