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楼主: 不拘一格

FC 声音正常图象出现杂色方块的不兼容现象

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发表于 2016-6-8 16:44:45 | 显示全部楼层
不拘一格 发表于 2016-3-21 17:142 Y0 F6 S7 |8 }! H! X" p
上面我做成本最低的二极管搭电路,需要选合适的高速开关二极管,同时上下拉电阻阻值在不同的机器中也要调整 ...
+ y: j! W4 M- H/ `
请问楼主74HC32N_6V与74HC08N_6V是同一个芯片还是连个芯片
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发表于 2016-6-8 19:02:22 | 显示全部楼层
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被接地,才会冲突,设计上无任何问题!fc每一个零件,每一个环节我都仔细研究了  f% C5 c! q9 \5 t% Y/ {# B
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 楼主| 发表于 2016-7-1 01:59:52 | 显示全部楼层
本帖最后由 不拘一格 于 2016-7-1 02:01 编辑 / [: w+ _$ |* @
孙大师 发表于 2016-6-8 19:025 i# T# b) j9 W. R# A
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被 ...

0 Y0 n' m6 s& O7 T2 E" g: z7 V
6 [2 \$ F8 K3 K; }  {% n! o/OE永远接地这种做法是不推荐的。. w$ G- S. @6 J" O' ?) y# G5 B
* D2 n% j) o1 z: V4 ^5 I
FC的设计是“技巧精妙”与“离经判道的”。之所以这样是为了压低硬件设计成本。
) u2 b9 z* h* i1 `: b
$ f" K4 d; K& T) w, b6 b2 g可能FC本身没有一个完善的/OE逻辑产生电路,如果要做这样的电路,需要消耗74门,或者用cpld写一个类似总线仲裁的桥接逻辑;
; T3 G# r( {+ @+ E+ [5 |7 |1 U7 M5 S6 c
以上修改其实也是用最低成本实现避免时序的交错。
- Y- t: o  |8 n& \7 Q) V# k
# ^* j- f$ _5 q" I, t  V- i- C理论的/OE时序信号,可以参考MD,以下是MD的信号在逻辑分析仪上测量抓取的图片(图片借用他人)
: x0 k5 L/ v& p6 l3 F

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